Module de traitement du signal numérique ABB G3HP HENF331132R0021

Module de traitement du signal numérique G3HP HENF331132R0021

Le module de traitement du signal G3HP contient essentiellement les fonctions de génération du signal numérique sortant. signal de l'émetteur et évaluation du signal du récepteur entrant, de l'affichage de l'alarme et de la programmation interrupteurs.

Le connecteur de diagnostic pour une borne de poche ou un PC est situé en face avant du module.

Le matériel du module DSP comprend le processeur de signal avec les mémoires de données et de programme, les différents des unités d'entrée et de sortie numériques, l'alimentation de l'horloge, une interface série et un "chien de garde".

Les entrées/sorties numériques et l'interface de diagnostic série sont contrôlées via un bus 8 bits, qui est complètement isolé du bus rapide du processeur 16 bits. À ce bus sont également connectés les 4 commutateurs pour programmation de l'équipement et des affichages LED sur la plaque frontale. Les tampons d'entrée/sortie pour communiquant avec les autres modules sont protégés par des résistances série et sont résistants aux courts-circuits jusqu'à 24 V.

Le processeur de signal est surveillé par un chien de garde qui, lors de la détection, actionne instantanément un alarme commune. Les relais d'alarme sont situés sur l'interface d'alarme G3HE et sur chaque interface de relais G3HC/D. Leurs contacts peuvent être sélectionnés pour être normalement ouverts (N/O) ou normalement fermés (N/C).

L'entrée et la sortie de caractères via l'interface de diagnostic sont effectuées par l'unité UART et le RS-Convertisseur d'interface 232. Dès que l'UART reçoit un caractère, il en informe le processeur au moyen de a interruption matérielle. Le processeur lit le caractère via le bus 8 bits et envoie le premier caractère du texte à retransférer à l'UART. L'UART demande plus de caractères avec d'autres interruptions jusqu'à ce que le le texte à transférer est complet.

L'interface de données du récepteur convertit le signal de ligne en un format de données série. Ces données sont transférées au processeur via les lignes FSR, DR et CLKR pour un traitement ultérieur. Dans l'émetteur, le signal de données DX généré par le processeur est lu à partir du registre à décalage série du DSP à l'aide de l'horloge et du informations sur le framework (CLKX et FSX) et transférées à l'interface de données qui les convertit en signal de ligne correspondant pour la transmission.

Spécifications techniques

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